，邏輯電路圖如圖1所示。| 邏輯關(guān)系測(cè)試結(jié)果 | 輸入輸出電平測(cè)試結(jié)果 | ||||||
| A | B |
 |
 |
 |
A端電平值（V） | B端電平值（V） |
 端電平值（V） |
| 0 | 0 | ||||||
| 0 | 1 | ||||||
| 1 | 0 | ||||||
| 1 | 1 | ||||||
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